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・Sixteen channel ADC 16-bit @ 250 MSPS
・Eight channel SAR ADC 16-bit @ 650 KSPS simultaneous
・Interface to the FPGA is via JESD204B
・24 LVDS for Clock/Trig and/or GPIO
・Eight channel SAR ADC 16-bit @ 650 KSPS simultaneous
・Interface to the FPGA is via JESD204B
・24 LVDS for Clock/Trig and/or GPIO
